`timescale 1ns / 1ps
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// Company: 
// Engineer: 
// 
// Create Date:    20:37:04 12/07/2011 
// Design Name: 
// Module Name:    SetL1 
// Project Name: 
// Target Devices: 
// Tool versions: 
// Description: 
//
// Dependencies: 
//
// Revision: 
// Revision 0.01 - File Created
// Additional Comments: 
//
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module SetL1(
    output [2:0] Line1,
    input [2:0] Switches
    );

	assign Line1[2:0] = Switches[2:0];

endmodule

module SetL2(
    output [2:0] Line2,
    input [2:0] Switches
    );

	assign Line2[2:0] = Switches[2:0];

endmodule
